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【DIY大赛】+反激+挑战自己,高功率密度DC-DC隔离电源的设计5V20A。

看到活动,心痒,手也痒。

肚子里没多少墨水,也要来掺和下。

预计设计一款外尺寸是50.8*50.8*12.7mm的电源。

功率上,准备挑战100W。

仅仅是挑战,能不能成不一定,但改好几次是肯定的了。

边调试边修改。


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chebd
LV.6
2
2018-08-23 09:05
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2018-08-23 09:56
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2018-08-23 15:14

       前辈你好!有个问题想请教一下,为什么我调试的一款反激电源的MOS DS端波形会有CCM、DCM波形并存的情况?MOS DS波形和PWM开关波形如下图波形所示。请前辈指点一二。

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2018-08-23 19:47
@伊若夏秋
      前辈你好!有个问题想请教一下,为什么我调试的一款反激电源的MOSDS端波形会有CCM、DCM波形并存的情况?MOSDS波形和PWM开关波形如下图波形所示。请前辈指点一二。[图片][图片][图片]

看你的波形很有规律,

是不是用内置MOS的芯片?

现在有些新的芯片,有抖频功能,或者是轻载间歇工作。

你这个是轻载时候的样子。

如果是3842这类的芯片,是不会有这样波形的。

即使有,也没这么规矩。没这么有规律。

38系列芯片出现这样的波形,那是环路没有调好。

你可以试着加大负载,看看波形是不是会连续起来。

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2018-08-23 19:57

这个电源输入是18--36VDC

输出5V 20A 

高度并不高,所以需要用到平面变压器。

这里有点小难度。打样一个16层板的平面变压器线圈,费用大约是两千多块。

思考了好几天,决定分成两块一模一样的8层板来做。这样也就花费一千多块就够了。

电路设计用 UC2843 来做。次级用 UCC24610 做同步整流。

初级和次级的MOS管都用贴片封装的。手头有5*6封装的80V MOS。

粗略计算了下,初级和次级都可以用这颗MOS。也省的去再买新料了。省点钱先。


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2018-08-23 20:10
@tanb006
这个电源输入是18--36VDC输出5V20A 高度并不高,所以需要用到平面变压器。这里有点小难度。打样一个16层板的平面变压器线圈,费用大约是两千多块。思考了好几天,决定分成两块一模一样的8层板来做。这样也就花费一千多块就够了。电路设计用UC2843来做。次级用UCC24610做同步整流。初级和次级的MOS管都用贴片封装的。手头有5*6封装的80VMOS。粗略计算了下,初级和次级都可以用这颗MOS。也省的去再买新料了。省点钱先。

自己算了下先,

磁芯选用TDK的 ELP22 。材质是PC95.

网上买来2块钱一副。没有打字,但是有配套的卡扣,可以不用胶带,这样裸着对散热还有好处。

这个磁芯的AE比较大,80个平方毫米。频率选择在145K。

选这个频率的目的只有一个,那就是次级可以只要一匝。初级3匝。辅助绕组2匝。

匝数越少,变压器走线越方便。

嗯,先画变压器去。

这里说下,多层板的变压器,出于经济方面的考虑,不要画盲孔。尽量利用半边画成通孔。

做盲孔的成本要高大约30--100%。对于自己玩玩来说还是太奢侈了。

所以我并不会直接画一个8层的变压器PCB。

而是先做一个模型。来验证小信号,和漏感、气隙等其他参数。

下一楼会用不到一百块来做这个能工作的变压器模型。只有平面变压器PCB成本的1/20哦。

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2018-08-23 20:33
@tanb006
自己算了下先,磁芯选用TDK的ELP22。材质是PC95.网上买来2块钱一副。没有打字,但是有配套的卡扣,可以不用胶带,这样裸着对散热还有好处。这个磁芯的AE比较大,80个平方毫米。频率选择在145K。选这个频率的目的只有一个,那就是次级可以只要一匝。初级3匝。辅助绕组2匝。匝数越少,变压器走线越方便。嗯,先画变压器去。这里说下,多层板的变压器,出于经济方面的考虑,不要画盲孔。尽量利用半边画成通孔。做盲孔的成本要高大约30--100%。对于自己玩玩来说还是太奢侈了。所以我并不会直接画一个8层的变压器PCB。而是先做一个模型。来验证小信号,和漏感、气隙等其他参数。下一楼会用不到一百块来做这个能工作的变压器模型。只有平面变压器PCB成本的1/20哦。

/upload/community/2018/08/23/1535026871-38911.pdf

这里先付上磁芯的PDF资料。

可以看到窗口高度是3.2毫米。

这里开始讲如何用100块成本来做到接近2000块打样费的平面变压器。

窗口的高度是关键。因为这关系到我的下一步工作。

柔性PCB可以做到0.2毫米的厚度。这正好是个优势。

假设,我画几个不同的线圈,初级3匝,次级1匝,这就是两个PCB。

画在一个板上,一起打样,也不会超过100块的。

回来再拆开,堆叠。自制一个多层PCB模型。

我做过0.2mm基板的PCB,铜厚是2盎司,板子的总厚度达到了0.36mm 算上中间的绝缘胶纸,粗略可以当0.4mm来计算。

窗口刚好可以放下8片。刚好可以依次放 P S P  S P S P 。

四层NP穿插三层NS。剩下一丁点空间留给胶带吧。不能太满了。

辅助绕组就随便用铜丝在空隙处绕2匝就OK。

当然,这样做出来的PCB打样价格会超过200块,因为铜厚加价了。我们就做普通的0.5盎司标准工艺就OK。

毕竟只是验证,不用考虑工艺。我只要波形就好。

验证好了绕法和工艺,再去花一千多打样8层板的PCB绕组也不迟。

不知道各位还有没有更好的做平面变压器的方法。我经验不足,这是我能想到的对我来说最划算的方法了。


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fysh
LV.5
9
2018-08-23 22:01
这个功率密度不算高
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2018-08-23 22:28
@fysh
这个功率密度不算高

我做着玩滴。其实我不知道自己几斤几两,

正好能遇到高人点拨,那我也算是没瞎折腾。

制作过程我会坚持不断更新,或一两天来一次,或三五天有点进度。

也希望各位看到不足之处能给指正。谢谢了!

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2018-08-24 08:36
@tanb006
看你的波形很有规律,是不是用内置MOS的芯片?现在有些新的芯片,有抖频功能,或者是轻载间歇工作。你这个是轻载时候的样子。如果是3842这类的芯片,是不会有这样波形的。即使有,也没这么规矩。没这么有规律。38系列芯片出现这样的波形,那是环路没有调好。你可以试着加大负载,看看波形是不是会连续起来。
我用的是uc2845,当前负载约30w,试着增大到60w波形也是这样
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2018-08-24 20:40
@伊若夏秋
我用的是uc2845,当前负载约30w,试着增大到60w波形也是这样

有没有原理图贴上来看看,另外,设计的参数也发一下。

包括电感量等等的。发出来,大伙都能帮你看看。

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xiaojb11
LV.4
13
2018-08-25 10:53
@tanb006
我做着玩滴。其实我不知道自己几斤几两,正好能遇到高人点拨,那我也算是没瞎折腾。制作过程我会坚持不断更新,或一两天来一次,或三五天有点进度。也希望各位看到不足之处能给指正。谢谢了!
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fysh
LV.5
14
2018-08-26 18:56
@fysh
这个功率密度不算高
3比1 有点少 频率太低了
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2018-08-26 22:32
@fysh
3比1有点少频率太低了

3:1只是假设。

频率的确定取决于最少的匝数:1匝。

在初级或者次级,任意线圈匝数为1的时候,

我认为,这已经是这个电源的最高频率了。

再往上,要作0.5匝也并非不可以。只是磁耦合会非常不理想。

还有一个限制频率的原因,在200K以上,即使在空载,MOS管的开关损耗也是非常大的。


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fysh
LV.5
16
2018-08-26 23:59
@fysh
这个功率密度不算高
不知道你咋坐哈 我们做的低压反激 都是200k到300k 效率最高有93点几
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fysh
LV.5
17
2018-08-27 00:02
@fysh
这个功率密度不算高
33x22x10 可以做70w
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2018-08-28 22:28
@fysh
不知道你咋坐哈我们做的低压反激都是200k到300k效率最高有93点几

能到93已经很不错了。毕竟初级电流太大。初级MOS的硬开关都是不小的损耗。

如果变压器不做好,漏感的损耗也很可观。

特别是在平面变压器上,如果不用PCB来做线圈,如何减小漏感,是个很有意思的话题。

下面有空的时候我会单独的谈一下如何在无骨架的情况下绕制一个漏感低于0.5%初级电感的变压器。

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2018-08-28 22:31
@fysh
33x22x10可以做70w

有点高端。想必是用了一些特殊的方法,例如:软开关,llc?

我这个帖子就只用UC2843来做,硬开关,次级同步整流。期望能有接近89%的效率就很好了。

只是想在反激里边再挖掘一些宝贝,制作的过程中能学到些知识。


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fysh
LV.5
20
2018-08-30 15:27
@fysh
这个功率密度不算高
你这个可以低些频率 磁芯大
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fysh
LV.5
21
2018-08-30 15:28
@fysh
这个功率密度不算高
三明治撒
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fysh
LV.5
22
2018-08-30 15:45
@fysh
这个功率密度不算高
低于 0.5不好测试
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fysh
LV.5
23
2018-08-30 15:45
@fysh
这个功率密度不算高
低于 0.5不好测试
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fysh
LV.5
24
2018-08-30 15:45
@fysh
这个功率密度不算高
低于 0.5不好测试
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2018-08-30 23:30
@fysh
低于0.5不好测试

测电感量是好测试的,我这单位有台300K的电桥。

你说的0.5是匝数?

还是漏感占初级电感量的百分比?

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2018-08-31 13:11
@fysh
不知道你咋坐哈我们做的低压反激都是200k到300k效率最高有93点几
你们怎么做的?用的什么控制芯片?
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2018-08-31 13:17
@fysh
不知道你咋坐哈我们做的低压反激都是200k到300k效率最高有93点几
fysh你们低压反激用的什么控制芯片?
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2018-08-31 18:24
@伊若夏秋
      前辈你好!有个问题想请教一下,为什么我调试的一款反激电源的MOSDS端波形会有CCM、DCM波形并存的情况?MOSDS波形和PWM开关波形如下图波形所示。请前辈指点一二。[图片][图片][图片]
你这示波器好用吗 多少价入的
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2018-09-02 10:55
@伊若夏秋
      前辈你好!有个问题想请教一下,为什么我调试的一款反激电源的MOSDS端波形会有CCM、DCM波形并存的情况?MOSDS波形和PWM开关波形如下图波形所示。请前辈指点一二。[图片][图片][图片]
这示波器用着怎么样
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fysh
LV.5
30
2018-09-02 11:12
@fysh
这个功率密度不算高
0.5%本来电感量就小
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fysh
LV.5
31
2018-09-02 11:13
@tanb006
测电感量是好测试的,我这单位有台300K的电桥。你说的0.5是匝数?还是漏感占初级电感量的百分比?
就是硬开关的也有90%
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