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复杂处理器的上电时序设计

2018-05-16 16:47 来源:ZLG致远 编辑:电源网

为确保芯片能可靠的工作,应用处理器的上下电通常都要遵循一定时序, 本文以i.MX6UL应用处理器为例,设计中就必须要满足芯片手册的上电时序、掉电时序,否则在产品使用时可能会出现以下情况,第一,上电阶段的电流过大;第二,器件启动异常;第三,最坏的情况会对处理器造成不可逆的损坏。可见,上下电时序对于确保系统的可靠运行起着重要的作用。

为确保芯片能可靠的工作,应用处理器的上下电通常都要遵循一定时序,以i.MX6UL应用处理器为例,设计中就必须要满足芯片手册的上电时序、掉电时序,否则在产品使用时可能会出现以下情况,第一,上电阶段的电流过大;第二,器件启动异常;第三,最坏的情况会对处理器造成不可逆的损坏。可见,上下电时序对于确保系统的可靠运行起着重要的作用。以下对i.MX6UL的电源框图进行说明,然后对其上电时序、掉电时序电路设计进行介绍。

一、i.MX6UL上下电时序要求

上电时序:

1.VDD_SNVS_IN 必须单独或与VDD_HIGH_IN 一起(短接)上电,在这之后其他电源才能上电。

2.如果使用纽扣电池为VDD_SNVS_IN 供电,请确保在开启任何其他电源之前将其连接。

3.应在VDD_SOC_IN 之前开启VDD_HIGH_IN。

掉电时序:

1.VDD_SNVS_IN 必须单独或与VDD_HIGH_IN 一起(短接)下电,在这之前其他电源必须全部完成下电。

2.如果使用纽扣电池为VDD_SNVS_IN 供电,请确保在关闭任何其他电源之后将其移除。

二 、i.MX6UL电源管理单元-PMU

图片1

三、要点分析

1.从i.MX6UL电源管理单元图可知,最先供电的VDD_SNVS_IN管脚是作为内部LDO_SNVS的输入,其输出电压VDD_SNVS_CAP是向SNVS模块及实时时钟模块OSC32K供电。 如需在掉电情况下保持RTC,则VDD_SNVS_IN需单独进行供电,否则可以与VDD_HIGH_IN接一起。VDD_SNVS_IN设计中可预留纽扣电池方案,以满足掉电保持实时时钟的应用需求,但如果使用纽扣电池为VDD_SNVS_IN 供电,请确保在开启任何其他电源之前将其连接。

图片2

图片3

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